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时序电路设计探讨
供稿: 雷乃清；李玉东；朱纪法 时间: 2019-05-20 次数:

作者：雷乃清；李玉东；朱纪法

作者单位：河南理工大学电气工程系；焦作爱依斯万方电力有限公司

摘要：通过一个设计实例,说明时序逻辑电路设计前的选型工作非常重要,如果选型不合适就可能得出错误结果.该实例被国内一些教材所引用,选用该例具有一定的意义.另外,还指出在状态图的化简过程中,对重复状态的认定应十分谨慎,绝不可把相似状态作为相同状态处理.

关键词：同步时序电路;时序机;状态图化简;

分类号：TN702

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